CAN-FD實體層PCB佈局設計要點:從差分走線到防護電路的工程細節
1 分鐘
- 一、CANH/CANL差分走線的阻抗與耦合控制
- 二、CAN收發器晶片的佈局原則
- 三、終端電阻的擺放:Stub是5Mbps下的隱形殺手
- 四、介面防護電路的擺放順序與選型
- 結語
車載電控、工業自動化設備逐漸把CAN-FD列為主幹通信標準。相較於傳統CAN最高1Mbps的仲裁段速率,CAN-FD資料段可達5Mbps甚至8Mbps,單幀負載也從8位元組擴充到64位元組,大資料量突發傳輸的場景確實受益明顯。
但速率上去之後,訊號上升沿被壓到幾奈秒等級,PCB走線上任何一處寄生電感、阻抗不連續,或是外部電磁干擾耦合,都會直接反映在匯流排波形上。實際除錯過程中最常遇到的狀況是:協定堆疊設定、鮑率計算都確認過,板子回來之後卻隨機出現錯誤幀,個別節點不定時進入Bus-Off狀態。多數情況下問題不在軟體,而是PCB實體層佈局留下的隱患。以下從硬體設計角度,整理CAN-FD佈局需要把關的幾個關鍵環節。
一、CANH/CANL差分走線的阻抗與耦合控制
車端或設備外部走的是雙絞線,特性阻抗120Ω。訊號進入PCB板內之後,CANH與CANL的走線品質決定了板內段的共模抑制能力,也影響整個鏈路的訊號完整性。
差分阻抗必須對齊120Ω
板內CANH、CANL走線同樣要按差分120Ω設計。如果板內段阻抗和電纜段不匹配,連接器介面處就會形成阻抗斷點,高速訊號在該位置產生反射,示波器上可以看到明顯的振鈴與過衝。
線寬、線距不能靠經驗值直接套用,要依據實際疊層結構、板材Dk值,用極點求解或場求解工具計算得到對應參數。走線全程保持平行、等間距,做到緊耦合;儘量避免一長一短,必要時在源頭端做長度補償,補償段不要放在接收器附近。
遠離強干擾源,包地必須對稱
CAN差分對不要與DCDC開關節點(SW pin)、馬達驅動PWM、大電流功率走線長距離平行。條件受限必須交叉時,走90度垂直交叉,把電容性耦合降到最低。
電磁環境惡劣的工業或車載場景,可以在CAN差分線兩側加保護地線並沿線多打接地過孔。這裡有個容易被忽略的細節:兩側包地線到差分對的距離必須左右對稱。如果一地線貼得近、另一側偏遠,差分對的對稱性被破壞,共模噪聲反而更容易轉換為差模干擾,適得其反。
二、CAN收發器晶片的佈局原則
CAN收發器是MCU數位邏輯與外部實體匯流排之間的介面,這一塊的佈局好壞,直接決定板級輻射發射(EME)和抗干擾能力(EMS)。
收發器儘量靠近對外連接器
佈局優先級最高的一條:收發器晶片要貼近DB9、接線端子等對外匯流排介面。核心目標是縮短收發器CANH、CANL引腳到連接器的銅箔長度,不要在板內繞大圈。
這段走線如果過長,PCB走線本身就具備天線效應:一方面對外輻射高頻諧波,另一方面外部ESD、EFT脈衝也更容易耦合進電路內部。實務上建議這段長度控制在幾毫米以內,走線下方保持完整地平面。
電源去耦與地平面完整性
收發器VCC引腳旁邊必須放置0.1μF搭配1μF的低ESR陶瓷電容,電容接地焊盤用最短銅箔直接打過孔連到內層完整地平面,減少回流環路面積。
收發器晶片正下方的地平面不要被其他走線開槽切割。完整地平面為差分訊號提供連續回流路徑,共模電流才能順暢洩放到地;地平面一旦出現縫隙,回流路徑被迫繞行,環路面積變大,EMI表現會明顯惡化。
圖1. CAN收發器佈局實例
三、終端電阻的擺放:Stub是5Mbps下的隱形殺手
CAN規範要求匯流排物理兩端各放置一顆120Ω終端電阻,用來吸收訊號反射。原理圖上放了電阻並不代表PCB就做對了,擺放位置不對,5Mbps下波形會很難看。
儘量做到零Stub
傳統CAN跑1Mbps時,少量短分支的影響並不明顯。但CAN-FD資料段跑到5Mbps時,任何從主幹分出去的Stub短截線都會形成阻抗不連續點,引發反射。
實務上的做法是:120Ω終端電阻直接跨接在CANH、CANL主幹走線上,不要留出幾毫米的支線再連接電阻。哪怕只有2-3mm的Stub,在5Mbps上升沿下都會產生可觀的反射,壓縮眼圖開口。如果設計上無法避免Stub,長度務必控制在傳輸延遲小於上升沿時間的1/6以內。
單電阻與分裂終端的取捨
一般工業設備用單顆120Ω電阻就夠了。對EMC要求嚴格的車載或高干擾場景,可以考慮分裂終端(Split Termination):用兩顆60Ω電阻串聯替代單顆120Ω,中間節點接一顆4.7nF陶瓷電容到地。
這個架構為高頻共模噪聲提供了到地的低阻抗路徑,能夠改善共模輻射。中間的濾波電容要緊貼兩顆電阻,接地過孔直接打在電容焊盤旁邊,不要拉長走線。
四、介面防護電路的擺放順序與選型
車載和工業現場的ESD、EFT快速脈衝、浪涌衝擊很常見,CAN介面必須加防護。但防護器件不是焊上去就有效,擺放順序和參數選型錯了,防護效果大打折扣,甚至會劣化高速訊號。
TVS選型要盯緊結電容
介面處通常加雙向TVS管吸收高壓脈衝。CAN-FD速率高,TVS的寄生結電容一定要嚴格控制,優選5pF以內,上限不要超過10pF。結電容過大,與走線寄生電感形成RC低通,會把訊號上升沿壓慢,導致取樣視窗內電平未達到閾值,通信直接出錯。
器件在PCB上的物理擺放順序不能顛倒,嚴格按照:
外部連接器 → TVS防護器件 → 共模扼流圈CMC → CAN收發器
若把TVS放到共模扼流圈後面,浪涌高壓先打到共模電感和收發器晶片上,TVS就失去了第一道屏障的意義。
圖2. CAN-FD完整信号链路
共模扼流圈的對稱性要求
共模扼流圈用來濾除線路上耦合的共模干擾。最關鍵的一點:扼流圈進出兩端的CANH、CANL走線必須幾何對稱,線寬、長度、過孔數量保持一致。
兩側走線不對稱時,扼流圈內部磁通量無法完全抵消,共模噪聲會被部分轉換為差模噪聲,通信反而更容易出錯。部分設計會在共模扼流圈正下方的內層地平面做挖空處理,降低元件與地平面之間的寄生電容,這一步務必參考器件原廠應用筆記的建議,不要自行判斷。
結語
CAN-FD把資料速率和單幀負載都提升了一個量級,但與之對應的是對PCB實體層更嚴格的約束。差分走線阻抗對齊120Ω、收發器貼近連接器、終端電阻杜絕Stub、防護器件按順序擺放,每一條都是硬體除錯過程中反覆驗證過的細節。
原理圖只完成了一半的工作,PCB佈局階段把這些規範落實到位,才能讓CAN-FD匯流排在嘈雜的電磁環境中長期穩定運行,避免後期反覆改板除錯。
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