Inspektion von Lötstellen in der PCB-Herstellung: Ein vollständiger Leitfaden zur frühzeitigen Erkennung von Defekten

Wichtige Erkenntnisse

Die Lötstellenprüfung ist in der modernen Leiterplattenfertigung von entscheidender Bedeutung, um Fehler frühzeitig zu erkennen und die Produktzuverlässigkeit sicherzustellen. Durch die Kombination von Lotpasteninspektion (SPI), 3D-AOI für sichtbare Lötstellen und Röntgenprüfung für versteckte BGA/QFN-Probleme können Hersteller häufige Defekte wie Lötbrücken, kalte Lötstellen, Tombstoning und Head-in-Pillow effektiv erkennen. Die Einhaltung der IPC-A-610-Normen mit einer mehrschichtigen Inspektionsstrategie reduziert Feldausfälle erheblich und verbessert gleichzeitig die Erstausbeute. Der professionelle Prozess von JLCPCB liefert hochwertige, vollständig geprüfte Leiterplatten sowohl für Prototypen als auch für die Serienproduktion.

Auf einem modernen Smartphone-Motherboard sind mehr als 3.000 Lötstellen auf einer Platine untergebracht, die kleiner ist als die Handfläche. Der Ausfall nur einer dieser Verbindungen im Feld genügt, um das gesamte Produkt zu Fall zu bringen. Das ist die Realität, und da die Baugruppen immer kleiner werden (0201-Passivbauelemente, BGAs mit 0,4 mm Pitch), ist die Lötstellenprüfung zum größten einzelnen Qualitätshebel in der Leiterplattenfertigung geworden.

Hier untersuchen wir den Unterschied zwischen guten und schlechten Lötstellen, welche Technologien für welche Probleme eingesetzt werden und wie man eine mehrschichtige Strategie entwickelt, um Defekte zu erkennen, bevor sie das Werk verlassen. Hersteller wie JLCPCB werden auch untersuchen, wie diese Systeme in ihre Produktionsprozesse integriert werden.

Was ist Lötstellenprüfung und warum ist sie wichtig?

Was beinhaltet eine Lötstellenprüfung also? Es ist der Prozess der systematischen Untersuchung aller Lötverbindungen auf einer bestückten Leiterplatte (PCB), um sicherzustellen, dass jede Lötverbindung elektrisch zuverlässig, mechanisch einwandfrei und frei von Defekten ist. Die verwendeten Methoden reichen von Sichtprüfungen mit Lupen über automatisierte optische Systeme bis hin zur Röntgenbildgebung.

Ein gutes Lötstellenprüfsystem ist mehr als nur ein Werkzeug zur Identifizierung schlechter Lötstellen; es ist ein System, das Verbesserungen im Prozess ermöglicht. Wenn eine AOI-Maschine feststellt, dass das Lot an einer bestimmten Stelle nicht ausreichend gut ist, untersucht der Ingenieur die Ursache und ersetzt entweder die Schablone oder behebt das Problem mit der Paste, bevor Hunderte von Platinen beschädigt werden. Die Inspektion ist kein Tor am Ende des Prozesses, sondern ein aktives Diagnosewerkzeug.

Die wahren Kosten der Ignorierung von Lötdefekten

Lötdefekte sind alles andere als Fehler, die nur darauf warten, aufzutreten. Eine kalte Lötstelle kann den Einschalttest bestehen, aber bei Temperaturwechseln verursacht diese hochohmige Verbindung intermittierende Ausfälle, die nur schwer zu beheben sind.

Die finanzielle Rechnung ist ziemlich einfach: Es kostet nur ein paar Cent, eine Lötstelle während der Montage zu reparieren, und Hunderte von Dollar, wenn sie nach der Lieferung und nach Ablauf der Garantiezeit gefunden wird. Bei medizinischer oder Automobilelektronik gehen die Folgen über den finanziellen Verlust hinaus bis hin zu Lebensgefahr. Deshalb legen IPC-A-610 und IPC J-STD-001 spezifische Zuverlässigkeitsklassen fest. Anforderungen der Klasse 3 sind notwendig, weil in einer sicherheitsrelevanten Feldanwendung keine Ausfälle akzeptiert werden.

Arten von Lötdefekten, die Sie kennen müssen

Die erste Phase einer effektiven Lötstellenprüfung ist das Verständnis der Defektlandschaft. Die folgenden sind die häufigsten Probleme in der Produktion:

1. Lötbrücken: Lötverbindungen zwischen benachbarten Pads (tritt bei feinem Pitch QFP, Passivbauelementen auf). Verursacht einen Kurzschluss für eine schnelle oder verzögerte Fehlfunktion.
2. Kein Lot: Die Verbindung wird nicht gelötet und ist Temperaturwechseln ausgesetzt.
3. Offene Lötstellen: Keine elektrische Verbindung zwischen dem Bauelementanschluss und dem Pad aufgrund schlechter Benetzung oder Oberflächenkontamination.
4. Kalte Lötstellen: Lot, das nicht geschmolzen ist oder die Oberflächen nicht benetzt hat, was zu einem körnigen Aussehen und einer schwachen Verbindung führt.
5. Tombstoning: Ein Ende des Chip-Bauteils wird während des Reflow-Prozesses vom Pad angehoben, was zu einem offenen Stromkreis führt.
6. Head-in-Pillow (BGA): Lotkugel und Lotpaste werden zusammen aufgetragen, aber die Lotkugel überlappt die Lotpaste nicht vollständig, sodass der Kontakt wie eine echte Kugelverbindung aussieht, während die Lötfestigkeit nicht signifikant ist.
7. Lotkugeln: Kleine Kugeln, die sich von den Verbindungen lösen und einen Kurzschluss verursachen können.

Die folgende Tabelle bietet eine Zusammenfassung der Defektarten, ihrer Ursachen und der besten Erkennungsmethode.

Versteckte Defekte: Die Herausforderung von BGAs, QFNs und HDI-Leiterplatten

In diesem Abschnitt werden wir die Probleme im Zusammenhang mit BGA-, QFN- und HDI-Leiterplatten erörtern und wie man sie angeht. Nicht alle Lötfehler sind offensichtlich. Einige der gefährlichsten befinden sich unter den Bauelementgehäusen, die weder von der Kamera noch vom menschlichen Auge erfasst werden. Hier wird die Inspektion von PCB-Lötstellen zu einer anspruchsvollen Aufgabe.

Das bekannteste sind Ball Grid Array (BGA)-Gehäuse. Unter dem Bauelementkörper befinden sich Hunderte von Lotkugeln, die nach dem Löten des Bauelements nicht sichtbar sind. Defekte wie Head-in-Pillow, innere Hohlräume und Non-Wet-Open müssen per Röntgenuntersuchung geprüft werden.

Ähnlich verhält es sich mit QFN (Quad Flat No-Lead)-Gehäusen. Das thermische Pad auf der Unterseite eines QFN dient sowohl als Masseverbindung als auch zur Wärmeableitung; es ist jedoch nach dem Reflow nicht sichtbar. Die thermische Leistung und Zuverlässigkeit sinken drastisch, wenn mehr als 25-50 % der Pad-Oberfläche von Hohlräumen eingenommen werden.

VIP (Via-in-Pad)-HDI-Leiterplatten erhöhen die Komplexität. Ein Mangel an Lot in ungefüllten Vias während des Reflows kann dazu führen, dass Lot von den Oberflächenlötverbindungen weggezogen wird, wodurch Bedingungen entstehen, unter denen nicht genügend Lot für eine gute Lötverbindung vorhanden ist – schwer zu erkennen ohne Querschnittsanalyse.

Wie die 3D-AOI-Inspektion funktioniert

Die Automatisierte Optische Inspektion (AOI) ist seit vielen Jahren ein fester Bestandteil der Leiterplattenbestückung, aber die 3D-AOI-Systeme sind keine gewöhnlichen 2D-Systeme. 2D-AOI kann flache Bilder aufnehmen und mit einem Satz von Referenzbildern vergleichen – nützlich für fehlende Bauteile, aber nicht für Lotvolumen und Hohlkehlenform, was zu hohen Fehlalarmraten führt. 3D-AOI überwindet dies durch die Projektion von strukturiertem Licht, unter Verwendung von Lasertriangulation oder Phasenverschiebungsprofilometrie, um echte Höheninformationen zu erhalten und Lotvolumen, Hohlkehlenform und Benetzungswinkel direkt zu messen. Hier ist ein direkter Vergleich der beiden Ansätze:

Moderne 3D-AOI-Anwendungen können mit Geschwindigkeiten von mehr als 60 cm pro Sekunde prüfen und Daten in Echtzeit in SPC (Statistical Process Control) exportieren, sodass Ingenieure Trends erkennen und eingreifen können, bevor Defekte entstehen.

Röntgenprüfung: Sehen, was die Optik nicht kann

Wenn die Oberflächenprüfung ausgeschöpft ist, kann die Röntgenprüfung (AXI) eingesetzt werden, um das Innere des Bauelementkörpers zu durchsuchen und die innere Struktur der Verbindung zu sehen. Hier sind die Szenarien, in denen die Röntgenprüfung der Leiterplattenanalyse unverzichtbar ist:

• Lotkugeln unter dem Gehäuse (BGA- & Micro-BGA-Gehäuse)
• Die QFN- und DFN-Gehäuse sind Beispiele für solche mit versteckten thermischen Pads.
• Doppelseitige Baugruppen mit unbekanntem optischem Zugang zur Barrel-Füllung.
• Die Verwendung von Package-on-Package (PoP)-Stapelung in Smartphones und IoT-Modulen
• Jede Anwendung, die eine quantitative Hohlraumanalyse für Zuverlässigkeitskonformitätszwecke erfordert

Es gibt 2 Modi. 2D-Röntgen liefert ein Durchstrahlungsbild, das schnell das Vorhandensein von BGA-Kugeln feststellt und Brücken identifiziert. 3D-CT (Computertomographie) erzeugt Querschnittsschnitte des Materials in jeder Ebene, um Hohlräume präzise zu messen und zu erkennen. Die einzelne Hohlraumfläche sollte nicht mehr als 25 % des Kugelquerschnitts betragen.

IPC-Normen, die die Akzeptanz von Lötstellen regeln

Normen sind für jede Diskussion über die Inspektion von Lötstellen unerlässlich und sind das Kriterium für die Bestimmung einer guten Lötstelle. IPC-A-610 ist die Hauptreferenz, und es gibt drei Akzeptanzklassen:

• Klasse 1: Allgemeine elektronische Produkte: Verbraucherprodukte, bei denen die wesentliche Funktion am Verkaufsort stattfindet.
• Klasse 2: Elektronische Produkte für den dedizierten Service: Industrielle/kaufmännische Geräte mit einer längeren Lebensdauer, aber einer akzeptablen Ausfallzeit.
• Klasse 3: Hochleistungselektronische Produkte: Luft- und Raumfahrt, Militär und medizinische Geräte, bei denen Ausfallzeiten nicht akzeptabel sind.

Die Anforderungen an Abmessungen, Benetzungswinkel und Hohlraumprozentsätze innerhalb jeder Klasse werden zunehmend höher. Die erste Entscheidung, die beim Aufbau eines Lötstellenprüfsystems getroffen wird, ist die Wahl der IPC-Klasse, da sie jeden Gut-/Schlecht-Schwellenwert beeinflusst.

Aufbau einer mehrschichtigen Inspektionsstrategie

Einer der häufigsten Fehler bei der Leiterplattenbestückung ist es, die Inspektion nur als einen Punkt am Ende der Linie zu betrachten. Die besten Systeme verteilen die Inspektion über mehrere Stufen:

• Lotpasteninspektion (SPI): Nach dem Schablonendruckprozess. Misst Höhe, Volumen und Position jeder Messung. Die meisten nachgelagerten Lötdefekte werden durch Defekte verursacht, die hier in der Paste entstanden sind.
• Pre-Reflow-AOI (optional): Zeitpunkt nach Bestückung, aber vor dem Reflow. Überprüft das Vorhandensein, die Ausrichtung und die Platzierung der Bauteile.
• Post-Reflow-3D-AOI: Erster Schritt der Lötstellenprüfung. Prüft alle sichtbaren Verbindungen auf: Brücken, unzureichende Lötung, Tombstoning und kalte Lötstellen.
• Röntgenprüfung: Wenn die Platine ein BGA-, QFN- oder Hidden-Joint-Gehäuse hat. Kann je nach Produkttyp 100 % oder stichprobenbasiert sein.
• ICT oder Flying Probe: Elektrische Verifikation, um sicherzustellen, dass die Verbindungen nicht nur optisch akzeptabel, sondern auch elektrisch funktionsfähig sind.
• Endkontrolle (FQC): Menschliche Sichtprüfung mit Vergrößerung vor der Verpackung.

Der mehrschichtige Ansatz ist ein Grundprinzip: Prävention ist wirtschaftlicher als Erkennung, und Erkennung ist viel wirtschaftlicher als Feldausfall.

Wie JLCPCB eine professionelle Lötstellenprüfung implementiert

Die SMT-Linien von JLCPCB sind mit einem mehrstufigen Inspektionsablauf konzipiert, der mit den oben genannten Best Practices übereinstimmt. Jede Platine wird bestückt und anschließend einer SPI-, 3D-AOI- und Röntgenprüfung (BGA/QFN-Designs) unterzogen – 100 % Prüfung auf Platinenebene von 5 Prototypen bis zu 5.000 Produktionsplatinen.

SPC-Daten von AOI und SPI fließen direkt in die Prozessoptimierung ein und identifizieren Trends, bevor sie zu Defektquellen werden. Reflow-Profile werden für jede Platinenkonfiguration optimiert, um eine gleichmäßige Verbindungsbildung zu gewährleisten. Der Bestückungsprozess vor Ort beginnt bei 6 $ und kann innerhalb von 1-2 Tagen abgeschlossen werden, was es JLCPCB leicht macht, eine professionelle Inspektion auf jeder Ebene bereitzustellen. Mit der EasyEDA-Integration gelangen Sie mit wenig Aufwand vom Design zu geprüften Platinen, und die Sofortangebotsfunktion spart Ihnen viel Zeit.

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FAQ zur Lötstellenprüfung

F: Was ist eine Lötstellenprüfung und warum ist sie wichtig?

Die Lötstellenprüfung ist die Bewertung von Lötverbindungen auf einer bestückten Leiterplatte, um zu verifizieren, dass jede Verbindung elektrisch einwandfrei, mechanisch zuverlässig und frei von Defekten ist. Sie ist wichtig, weil bereits eine defekte Verbindung Feldausfälle verursachen kann und das Erkennen von Defekten während der Produktion weitaus kostengünstiger ist als Garantierücksendungen.

F: Was ist der Unterschied zwischen 2D-AOI und 3D-AOI bei der Inspektion von Lötstellen?

2D-AOI erfasst flache Bilder und verwendet Mustervergleich, während 3D-AOI durch strukturiertes Licht oder Lasertriangulation Höhenmessungen hinzufügt. 3D-AOI misst Lotvolumen, Hohlkehlengeometrie und Koplanarität direkt, was zu weniger Fehlalarmen führt (unter 1-2 % gegenüber 5-10 % bei 2D) und eine zuverlässigere Erkennung ermöglicht.

F: Wann sollte die Röntgenprüfung anstelle optischer Methoden eingesetzt werden?

Die Röntgenprüfung ist unerlässlich, wenn eine Platine Bauteile mit versteckten Lötstellen wie BGAs, QFNs, DFNs oder Durchkontaktierungen auf doppelseitigen Baugruppen enthält. Sie ist auch für die quantitative Hohlraumanalyse in zuverlässigkeitskritischen Anwendungen erforderlich.

F: Welche IPC-Normen definieren die Akzeptanzkriterien für Lötstellen?

IPC-A-610 (Akzeptanz elektronischer Baugruppen) ist die primäre Norm und definiert drei Akzeptanzklassen mit zunehmend strengeren Anforderungen an die Verbindungsqualität.

Fazit

Die Inspektion von Lötstellen ist eine grundlegende Notwendigkeit bei jeder Leiterplattenbestückung, die ordnungsgemäß funktionieren soll. SPI erkennt Pastenprobleme an der Quelle, 3D-AOI ermöglicht volumetrische Messungen jeder sichtbaren Verbindung, und die Röntgenbildgebung bietet Sichtbarkeit von Defekten unter BGA und QFN, die keine optische Methode erreichen kann.

Da die Baugruppen immer kleiner und die Platinendichten immer höher werden, werden Ingenieure, die wissen, wie sie diese Inspektionsebenen anwenden und mit Herstellern zusammenarbeiten, die diese liefern können, weiterhin zuverlässigere Produkte auf den Markt bringen. Für Ihr nächstes Design, das einen so hohen Qualitätsstandard erfordert, bieten die hochwertigen Inspektionsmöglichkeiten und die transparente Preisgestaltung von JLCPCB eine solide Grundlage.</p